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电气约束——Wiring工作表应用实例

Wiring设计规则能帮助用户控制噪声和信号失真。首先在Electrical Constrain Set文件夹下建立约束,再将此约束分配给Net文件夹内的Net或者Bus如图所示

定义Net的拓扑结构,就是指此Net(或Xnet)在布线时实际的布线顺序。用户可先选择预先定义的Schedule,如下拓扑结构所示


Minimum Spanning Tree结构用最短的距离连接所有的Pin

Daisy Chain结构以点到点的序列方式连接所有的Pin,每个PIN最多连接另外两个Pin

Source Load Daisy Chain结构类似于简单的Daisy Chain结构,只是先连接所有的驱动端,再连接所有的接收端。

Star结构先将所有的驱动端以Daisy Chain结构连接起来,然后所有的接收端都连接到最后一个连入驱动端Daisy Chain的那个驱动端上,如图


Far End Cluster结构类似于Star结构,只是最后一个驱动端简介到一个“T”形节点上,然后所有的接收端都连接到这个“T”形节点上。

在实际使用中,采用默认的拓扑很少,主要是采用自定义的拓扑来使用。通过以下实例来说明

选择Setup->constrain->Electrical命令。启动约束管理器。

选择net RD4,单击鼠标右键,在弹出的快捷菜单中选择SigXplorer命令。


打开SigXplorer,网络初始的拓扑结构如图所示。

图中是根据用户布局放置芯片的位置,系统自动产生的拓扑结构。如果不设置,在实际布线时是可以任意相连的,并不会按图中的顺序来布线。

对当前拓扑结构进行调整,调整后拓扑结构如下图所示。


在实际使用中,有很多用户会碰到拓扑丢失,甚至于约束规则丢失,主要的原因是设置的条件比较窄,当拓扑中有参数改变时,此规则就不再满足条件,系统就会放弃当前的规则。要想让当前的拓扑能适应更多的网络,可以在设置上设置但对宽松的条件。

下面介绍下如何建立一个适用范围广的拓扑结构。

1)     在SigXplorer中,选择Setup->Constrain命令,选择Wiring选项卡。


1)     在Topology选项组中设置相应选项。

Ÿ Mapping Mode

Ø Pinuse表示按PIN的类型来映射网络。用户有时给零件赋IBIS模型后,PIN的类型会根据IBIS模型来改变。

Ø Refdes表示按照零件位号来建立映射关系。如果需要多个映射,可以改变Cell的位号。

Ø Pinuse and Refdes表示前两种方法都实用。只要一种满足条件就可以。

Ÿ Schedule表示选择拓扑的形式。

Ÿ Verify Schedule表示是否检查拓扑。Yes表示检查,No表示不检查。

2)     单击OK按钮,退出设置窗口。

3)     除去上面的措施,还可将Cell变成Option的方式来增加适用范围。

4)     选择Update CM,单击OK按钮。弹出Electrical CSet Apply Information窗口。

5)     鼠标放到RD4上单击鼠标右键,在弹出的快捷菜单中选择Create->Electrical CSet命令。弹出Create Electrical CSet窗口。


1)     输入电气规则的名字,点击OK

2)     选择要赋规则的网络,单击网络Referenced Electrical CSet


1)     把E-RD4规则赋给A0,会发现规则变红,表明不满足拓扑的条件。选择A0行,鼠标放到E-RD4上,然后单击鼠标右键,在弹出的快捷菜单中选择Audit Electrical CSet,弹出Electrical Apply Information。可以看到产生错误和警告的原因了。

2)     当然,直接在PCB Editor界面中也可以设置拓扑结构。但要设置最复杂的拓扑,还要到SigXplorer里面才可以。

总结:拓扑的设置是电气约束中最重要的约束之一。当发生丢约束时,一定要分析约束丢的原因,这样才能改正。下面是几个简单的辨别条件:

1)   检查Xnet/net上节点的数量同已有的拓扑是否吻合。

2)   检查Pinuse/Class是否对应

3)   检查分离零件(电阻、电容)的值。

在Wiring里面还有几个约束。

Stub指的是主要线路和引脚之间的连线。这个值是越小越好。需要注意的是这个值并不包括过孔的Stub

Exposed Length表示当前网络在PCB外层的长度之和。这个值越小越好。可以有效地减少EMC

Parallel表示当前net同相邻允许平行走线的长度。

Layer Sets表示当前网络必须布在某一层或者层对上。

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